/ | Systematischer Entwurf analoger Low-Power Schaltungen in CMOS anhand einer kapazitiven Sensorauslese | Fraunhofer IRB | 2008
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In der Mikroelektronik sind energiesparende Schaltungen von wachsender Bedeutung, insbesondere für batteriebetriebene Geräte oder passive Transpondersysteme. Der systematische Entwurf analoger Low-Power Schaltungen wird hier am Beispiel einer Ausleseschaltung für monolithisch integrierbare, kapazitive Drucksensoren durchgeführt. Von den entwickelten Schaltungen wurden zwei ADUs (Analog-Digital-Umsetzer) als Testchip gefertigt. Die Minimierung der Leistung wird auf verschiedenen Ebenen untersucht. Die drei Hauptebenen befinden sich in der Technologie, der Schaltungstechnik und der Systemarchitektur, wobei die beiden letzteren den Schwerpunkt dieser Arbeit bilden. Auf der Ebene der Schaltungstechnik wird die beste Leistungseffizienz am Beispiel eines Tiefpasses erster Ordnung mit einem bestimmten Signal-zu-Rausch Verhältnis SNR für vier verschiedene Schaltungstechniken bestimmt. Die Systemarchitektur wurde am Beispiel der ADU-Architektur untersucht. Auch hier wird das theoretische Minimum des Leistungsverbrauchs für ein bestimmtes SNR angegeben. Das theoretische Minimum stellt gleichzeitig das Minimum für die Praxis dar. Zum besseren Vergleich von ADUs, die in verschiedenen Technologien gefertigt worden sind, wird ein technologieunabhängiges Figure of Merit eingeführt. Dabei wird gezeigt, dass die fortschreitende Technologieskalierung in CMOS hilft, dem theoretischen Minimum näher zu kommen.

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